Electronic Engineering/Digital Logic Design

Verilog 설계 : 8bit Ripple Carry Adder

해시브라우니 2022. 7. 6. 16:06

주어진 full_adder.v를 다음과 같은 구조로 수정 후 주어진 ripple carry adder를 8비트로 확장하여 시뮬레이션 진행

8bit-full-adder CODE Explanation.pdf
0.08MB
8bit-full-adder.pdf
0.42MB
full_adder.v
0.00MB
ripple_carry.v
0.00MB
TB_ripple_carry.v
0.00MB